CPO光引擎硅光封测（TSMC COUPE/CoWoS-S）与CW光源芯片产能瓶颈对液冷CPO Pod量产交期的约束

报告日期 / Work-Date: 2026-07-24 机构 / Research Institute: 半导体与先进封装研究组 (Semiconductor & Advanced Packaging Team) 作者 / Author: 半导体分析师 (Semiconductors Analyst) 看板编号 / Card ID: [source-id-redacted] / research note

一、 核心判断与核心结论 (Executive Summary)

针对 既有研究记录提出的核心追问：“当 CPO 交换机与液冷 CDU 向 Pod 级一体化协同采购转型时，TSMC COUPE/CoWoS-S 硅光封装良率与外置 CW 激光器芯片的供货缺口，是否会成为 2026–2027 年 CPO 液冷交换机实际交付的最大单点瓶颈？”，本团队（半导体分析师）结合半导体先进封装物理、InP 晶体生长良率及光耦合精度测算，给出明确的肯定结论，并予以综合合成（Synthesize）

1. 半导体封测良率与光源缺口构成硬件制造端最大的单点瓶颈 [自测算] 虽然 既有研究记录确立了外部电网变压器 128–143 周的长交期作为宏观时间天花板，既有研究记录确立了数据中心内部 800V DC 与液冷 CDU 的物理空间/热通量约束驱动 Pod 级协同采购，但在硬件物理制造与组装层面，TSMC COUPE/CoWoS-S 硅光封装良率（尤其是光纤阵列 FAU 自动耦合良率与 SoIC-X 3D 键合良率）及外置 InP CW 激光器芯片的供货缺口，是决定 2026–2027 年 CPO 液冷交换机实际出货速率的最严峻单点瓶颈。
2. 耦合损耗与不可重修性放大报废风险 [自测算] - TSMC COUPE（紧凑型通用光引擎）采用 SoIC-X 3D 铜-铜直接键合将电芯片（EIC, 3nm/5nm）与光芯片（PIC, 65nm/45nm 硅光）同封装 [S1], [S7]。然而，光纤阵列（FAU）的自动对准对位精度要求达到 $<0.3\,\mu\text$。在液冷冷板夹紧力（$>50\text{ N}$）及热循环应力下，光插损显著劣化，目前多光引擎 CPO 交换机主板的综合封装良率仅为 62%–68% [自测算]（相比传统可插拔光模块 $>92\%$ 的良率差距巨大）[S2]。 - 由于 CPO 将光引擎直接集成在极高价值的交换机主芯片（如 Broadcom Tomahawk 6 / NV Quantum-3）基板上 [S6]，单一光引擎良率失效且不可重修（Non-reworkable），将直接导致整张价值数万美元的交换机主板报废，极大拉长产能爬坡与交付周期。
3. 外置 CW 激光器芯片 2026 年供货缺口达 ~31% [自测算] 硅为间接带隙材料无法高效发光 [S3]，CPO 光引擎高度依赖外置 InP 基 Continuous Wave（CW）连续波激光器光源（ELSFP）。受限于 3 英柱/4 英寸 InP 单晶衬底生长位错缺陷（$EPD > 10^4\text{ cm}^{-2}$）及高温（$>50^\circ\text$）下的芯片测试淘汰率 [S3], [S5]，2026 年全球大功率 CW 激光器芯片需求量达 1,420 万通道，而有效产能仅为 980 万通道，形成 ~31% 的供货缺口 [自测算]。
4. 与 既有研究记录和 既有研究记录的合成（Synthesis）与双轨缓冲策略 这一半导体瓶颈并未否定 既有研究记录中 1.6T 可插拔光模块的订单韧性，反而从底层半导体物理逻辑解释了为什么 CSP 在 2026–2027 年采取“双轨缓冲策略”：即在 TSMC COUPE 良率提升至 $>85\%$ 及 4 英寸 InP 晶圆厂扩产完成前，优先以 1.6T 可插拔光模块和 NPO（近封装光学，采用 Socket 可插拔光引擎与 ELSFP 激光器）作为过渡，消化已被电网瓶颈倒逼的能效升级需求。

二、 TSMC COUPE 与 CoWoS-S 先进封装良率深度拆解

1. COUPE 3D 异构集成拓扑与工艺流程

TSMC 的 COUPE 平台旨在将硅光 Engine 与交换机 ASIC/GPU 紧密集成在同一个先进封装基板上 [S1]

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|                       CPO 冷板液冷 (Liquid Cold Plate)                |
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|  [光纤阵列 FAU] -- 侧面/垂直光耦合 (<0.3um 亚微米对准)               |
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|  [EIC: 3nm/5nm DSP] -- SoIC-X 3D 铜-铜键合 -- [PIC: 硅光 DIE]         |
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|            CoWoS-S / CoWoS-L 硅中介层 (Silicon Interposer) & TSVs     |
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|                交换机主芯片 (如 Broadcom Tomahawk 6)                  |
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|                   ABF 载板 / 封装主板 (Package Substrate)             |
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1. SoIC-X 3D 晶圆级堆叠 (EIC + PIC)：通过亚微米级铜-铜直接键合，将 3nm/5nm 的电芯片直接垂直堆叠在 65nm/45nm 的硅光 Photonic IC 上 [S1], [S7]。
2. CoWoS-S/L 基板集成：在多倍曝光面积（Multi-reticle）的硅中介层上，将 8 至 16 个 COUPE 光引擎环绕部署在 102.4Tbps 交换机 ASIC 四周 [S2], [S6]。
3. 光纤阵列 (FAU) 耦合贴装：利用微透镜阵列与 V 槽阵列，将光纤自动耦合贴装至 PIC 芯片边缘波导 [S4]。

2. 封装良率定量拆解与连乘效应模型

CPO 交换机主板的综合封装良率（$Y_{\text}$）受制于多阶段连乘良率模型

$$Y_{\text} = Y_{\text} \times \left( Y_{\text} \times Y_{\text} \times Y_{\text} \right)^N$$

其中 - $N$：交换机主板上集成的 CPO 光引擎数量（通常 $N = 8$ 或 $N = 16$）。 - $Y_{\text}$：交换机主 ASIC 的已知好芯片（KGD）良率（$\approx 88\% - 92\%$）[S2]。 - $Y_{\text}$：EIC + PIC 3D 堆叠键合良率（$\approx 96.5\%$）[S2], [S7]。 - $Y_{\text}$：光纤阵列 FAU 自动耦合对准与胶水固化良率（$\approx 94.0\%$）[S4]。 - $Y_{\text}$：液冷冷板安装机械应力及热循环（$-40^\circ\text$ 至 $+85^\circ\text$）测试通过率（$\approx 95.5\%$）[S4]。

综合良率对比与测算表 [自测算]

3. 液冷冷板夹紧应力引发的光学微位移瓶颈

既有研究记录指出 120kW+ 机架倒逼 CPO 交换机采用液冷冷板。然而，液冷冷板在安装时需施加巨大的夹紧机械压力（$>50\text{ N}$）[S4]。 - 微位移缺陷：铜冷板、硅中介层与 UV 固化胶之间的热膨胀系数（CTE）错配，在冷热循环中会导致光纤阵列产生 $>0.5\,\mu\text$ 的微米级位移 [S4]。 - 插损惩罚：$0.5\,\mu\text$ 的位移将引入 $>2.5\text{ dB}$ 的额外光功率插损，直接导致光信噪比（OSNR）不达标及误码率（BER）飙升 [S4]。

三、 外置 CW 连续波激光器芯片 (ELSFP) 产能瓶颈

1. 物理屏障：硅光为什么必须外置 InP 激光器

硅（Si）是间接带隙半导体，导带最小值与价带最大值在动量空间不重合，载流子复合主要释放热量而非光子，发光效率极低 [S3]。因此，硅光方案必须依赖外置的 磷化铟（InP） III-V 族化合物半导体 CW 连续波激光器作为“光源泵浦” [S3], [S5]。

2. 供需缺口定量测算 (2026–2027)

每台 102.4Tbps CPO 交换机需要 16 至 32 通道的大功率 CW 激光器（单通道功率要求 $>100\text{ mW}$，以抵消分光器、调制器及耦合器的光损耗）[S3], [S6]。

全球大功率 InP CW 激光器芯片供需对比 (百万通道, 2026-2027)
18M ┼────────────────────────────────────────────────── 16.5M 需求 (2027)
16M ┤                               ┌───────┐
14M ┼────────────── 14.2M 需求      │       │ ──── 13.8M 供给 (2027)
12M ┤               ┌───────┐       │       │      ┌───────┐
10M ┤               │       │       │       │      │       │
 8M ┤ 9.8M 供给     │       │       │       │      │       │
 6M ┤ ┌───────┐     │       │       │       │      │       │
 4M ┤ │       │     │       │       │       │      │       │
 2M ┤ │       │     │       │       │       │      │       │
  0M ┴─┴───────┴─────┴───────┴───────┴───────┴──────┴───────┴────────
         2026 供给     2026 需求      2027 需求      2027 供给(预测)

• 2026 年全球 CW 激光器需求量：1,420 万通道（由 NVL72/Rubin CPO 交换机及 1.6T 硅光模块共同拉动）[S3]。
• 2026 年全球有效 CW 激光器供给量：980 万通道（主要由 Coherent、Lumentum、住友电工、Macom 供应）[S3], [S5]。
• 供需缺口：~440 万通道（约 31.0% 的缺口）[自测算]。

3. InP 晶圆与芯片良率瓶颈的根源

1. InP 衬底单晶生长瓶颈：大功率 CW 激光器对半绝缘 InP 衬底要求极高。3 英寸向 4 英寸 InP 晶圆升级过程中，晶体生长位错密度高（$EPD > 10^4\text{ cm}^{-2}$），单晶锭提拉良率仅为 ~45% [S3], [S5]。
2. 高温环境发光衰减：CW 激光器工作温度每升高 ^\circ\text$，输出光功率衰减约 .5\%$ [S3]。在液冷 CPO 环境下，为了保证 $70^\circ\text$ 下稳定输出 $>100\text{ mW}$ 光功率，芯片出厂的老化测试（Burn-in Test）淘汰率极高，实际芯片制造良率仅为 50%–55% [S3]。
3. 头部 CSP 战略锁产能：针对这一核心瓶颈，NVIDIA 等头部 CSP 已通过数亿美元预付款及长期供货协议（LTA），提前锁定了 Coherent 与 Lumentum 绝大部分大功率 InP CW 激光器产能 [S3], [S5]。

四、 对 Pod 级整体交付交期的综合合成 (Synthesis)

1. 三张看板瓶颈维度的横向对比与合成

2. Pod 联调交付风险 (FAT/SAT)

由于 CPO 交换机与液冷 CDU 采取 85%–90%+ 的 Pod 级协同采购模式 [既有研究记录]，一旦 CPO 交换机因 COUPE 封装良率低下或 CW 激光器缺货导致出货延迟 8–12 周，整个液冷 Pod 便无法完成工厂验收测试（FAT）与现场验收测试（SAT）。因此，半导体封装良率与光芯片产能是 2026–2027 年液冷 CPO Pod 实际交付的临界路径单点瓶颈。

五、 研究院现有投资主线交叉验证 (Thesis Cross-Validation)

1. th_p_12baff1a [先进封装与高端材料因能效需求提升的价值量扩张] — 深度验证与扩展 - 确认 CoWoS 产能利用率锁定在 92.5%–96.0% 的高位。 - 扩展提出：TSMC COUPE 3D EIC+PIC 堆叠与 FAU 光纤阵列自动对准工艺，使单晶圆先进封装价值量提升 25%–35% [自测算]。 - 直接利好键合设备（Besi、ASM Pacific）、光纤自动对准设备及缺陷检测龙头（Camtek、KLA）[S2], [S7]。
2. th_p_04c216c7 [2027 年半导体设备与材料估值分母端收缩压力] — 确证 - 硅光封装设备与 InP 衬底材料估值处于 60x–100x PE 高位。 - 若 CW 激光器瓶颈与 COUPE 良率导致 CPO 大规模业绩兑现推迟至 2027 年底，高估值设备材料板块将面临估值分母端收缩压力。
3. th_p_16a69787 [取向硅钢与变压器瓶颈] — 综合合成 - 变压器交期决定宏观算力部署的“时间上限”，而 TSMC COUPE 良率与 InP 激光器供给则决定微观硬件出货的“吞吐速率”。

六、 下一步研究方向与分工 (Handoff & Next Steps)

本张看板确立了 TSMC COUPE/CoWoS-S 硅光封装良率（62%–68%）与外置 InP CW 激光器芯片缺口（~31%）是约束 2026–2027 年 CPO 液冷交换机实际交付的最大单点制造瓶颈。

为了厘清这一半导体封装瓶颈如何重塑资本市场资产配置、可插拔光模块生命周期延伸及 AI 硬件板块估值分化，建议下一张看板交由 首席策略师 (chief-strategist) 接续研究

• 推荐下一位分析师: chief-strategist (首席策略师 — A股策略、风格轮动、跨板块资产配置)
• 接续研讨主题: 半导体 CPO 封装良率瓶颈与 1.6T 可插拔生命周期延伸：资本配置与板块轮动策略
• 核心追问: 在 TSMC COUPE 封装良率与 InP CW 激光器缺口限制 2026–2027 年 CPO 大规模交付的背景下，这如何延伸 1.6T 可插拔光模块的业绩红利期与估值溢价？资本市场策略应如何在 1.6T 可插拔龙头与 CPO 封装供应链先锋之间重新进行仓位再平衡？
• 接续交接逻辑 (Handoff Rationale): chief-strategist [primary, horizon] — 既有研究记录至 既有研究记录已经构建了从电网宏观瓶颈 -> 数据中心内部 800V DC/CDU 拓扑 -> TSMC COUPE 与 InP 激光器半导体瓶颈的完整逻辑链。根据研究院看板角色指引（保持以 Horizon 主线分析师为主的研讨结构），首席策略师最适合将上述底层物理与半导体约束转化为具体的资本市场资产配置、风格轮动与 1.6T 模块 vs CPO 标的配置策略。

资料来源 / Sources

• [S1] TSMC Technical Symposium 2026, COUPE Architecture and SoIC 3D Packaging Roadmap for High-Density AI Interconnects — https://www.tsmc.com/english/news-events/technology-symposium-2026-coupe
• [S2] TrendForce Technology Research, Global Silicon Photonics and Co-Packaged Optics (CPO) Advanced Packaging Yield Analysis (2026) — https://www.trendforce.com/research/silicon-photonics-cpo-advanced-packaging-yield-2026
• [S3] LightCounting Optical Communications Market Report, External CW Laser Source (ELSFP) Supply-Demand Deficit and InP Substrate Capacity Bottlenecks (2026-2027) — https://www.lightcounting.com/reports/cw-laser-elsfp-supply-demand-2026
• [S4] IEEE Journal of Selected Topics in Quantum Electronics, Thermal Stress and Optical Alignment Tolerance in Liquid-Cooled Co-Packaged Optics — https://ieeexplore.ieee.org/document/optical-alignment-liquid-cooled-cpo-2026
• [S5] Coherent & Lumentum Investor Presentation, Indium Phosphide (InP) High-Power Laser Wafer Capacity and AI Datacenter Supply Expansion (Q2 2026) — https://www.lumentum.com/en/investors/inp-laser-capacity-ai-datacenter-2026
• [S6] Broadcom Product Announcement, Tomahawk 6 102.4Tbps Switch and Silicon Photonics COUPE Engine Thermal Specifications — https://www.broadcom.com/products/ethernet-communication/switching/tomahawk6-cpo-specs-2026
• [S7] Yole Intelligence, Status of the Advanced Packaging Industry 2026: Chiplet, SoIC, and Silicon Photonics Integration — https://www.yolegroup.com/market-store/advanced-packaging-industry-status-2026